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具有用于互連位線的連接引線的半導(dǎo)體集成電路

發(fā)明專利無效專利
  • 申請?zhí)枺?/span>
    CN02150529.2
  • IPC分類號：H01L27/10;G11C11/34
  • 申請日期：
    2002-11-12
  • 申請人：
    富士通株式會社
著錄項信息
專利名稱具有用于互連位線的連接引線的半導(dǎo)體集成電路
申請?zhí)?/td>CN02150529.2申請日期2002-11-12
法律狀態(tài)權(quán)利終止申報國家中國
公開/公告日2003-09-10公開/公告號CN1441497
優(yōu)先權(quán)暫無優(yōu)先權(quán)號暫無
主分類號H01L27/10
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IPC結(jié)構(gòu)圖譜：
IPC分類號H;0;1;L;2;7;/;1;0;;;G;1;1;C;1;1;/;3;4查看分類表>
申請人富士通株式會社申請人地址
日本東京 變更 專利地址、主體等相關(guān)變化，請及時變更，防止失效
權(quán)利人富士通微電子株式會社當(dāng)前權(quán)利人富士通微電子株式會社
發(fā)明人野呂幸一
代理機(jī)構(gòu)中國國際貿(mào)易促進(jìn)委員會專利商標(biāo)事務(wù)所代理人王永剛
摘要
多個存儲單元陣列，包括位線和各自由可變電容器構(gòu)成的存儲單元，并且工作在彼此不同的同步計時。每一個存儲單元陣列的位線通過連接引線連接到其它存儲單元陣列。因而位線的實際電容是存儲單元陣列自身位線的電容，加上其它存儲單元陣列位線的電容，加上連接引線的電容。因此，在從存儲單元讀出數(shù)據(jù)時，可以放大由電容分割引起的位線電壓變化。結(jié)果可以防止讀裕量惡化，并且可以防止半導(dǎo)體存儲器的制造產(chǎn)量下降。此外，由于放大了位線電壓變化，可以縮短數(shù)據(jù)讀取時間。

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